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DS878是一款高速直接數字頻率合成器(DDS)，頻率調諧分辨率為32位，ROM相位分辨率為13位，DAC幅度分辨率為11位。DAC模擬輸出可在正常保持模式（用于第一奈奎斯特頻段）和回零模式（用于第一，第二和第三奈奎斯特頻段）操作之間選擇。DS878和DAC正常保持模式下，可在第一奈奎斯特頻段附近產生最高1.8 GHz的頻率（時鐘速率為3.6 GHz），或在DAC調零模式下產生最高5.4 GHz的第三奈奎斯特頻段。

DS878初始相位可以復位到零度啟動。該芯片有一對互補的模擬輸出，后端為50-∧。輸出波形的頻率可由32個頻率控制位VI[0:31]控制。DS878可接受差分時鐘輸入或單端時鐘輸入，具有50-∧片內后端端子和用戶自定義閾值。頻率分辨率位接受LVTTL或CMOS輸入電平。差分同步輸入SYNCI_P/N為多個芯片應用提供同步，啟動每個芯片準備接受頻率字輸入。

DS878內部產生的同步選通輸入除以8時鐘躍遷沿鎖存器，這些時鐘也發送到SYNCO_P/N。輸出引腳SYNCO_P/N作為參考，頻率字和頻閃輸入時序與內部同步，以8個時鐘分頻，從而正確鎖定。復位是異步的，以最大限度地降低模擬輸出有效性的時鐘延遲。

DS878主要特征

32位的頻率調諧字

13位ROM相位地點介紹

國外電影中的11位dac

鬧鐘速度高達hg4.5GHz

養成導出應該在順利始終保持文件類型文件和零文件類型文件相互間開始會選擇

余弦波引發的最個奈奎斯特帶達到了2.25GHz，第三方個奈奎斯特中波段趨于穩定正常人保持著形式 或6.75GHz零化形式。

在4 GHz鐘表傳送速度下，最次的寬帶網SFDR介于50 dBc(dc到2 ghz帶寬的配置)

50后臺開發相容模擬訓練波形圖導出

多片同時進行P/N同樣

SyncO_P/N為統計數據打開和關聯選溝通號供給了考慮。

LVTTL/CMOS羅馬數字的模式把控好錄入

異步回零(RST)引腳疏導0環節(IQSL=低)或90(IQSL=高)通電程序

適用于刷新頻繁 Word和DAC輸入幀率的Strobe放入(STRBUP/N)

寬的數劇彈出視口能DS 878由保存器和微控住器控住，FPGA或DSP集成ic在掛鐘頻次改換的過程中不須抱死或故障率就就可以系統更新數最多8個數字時鐘周期公式的頻繁字。

單-5V電源開關的工作頻率為4.3W

64針QFN9x9封裝形式

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